Proposta de uma plataforma reconfigurável para testes de módulos SDRAM DDR3
| Orientador(a) (dc.contributor.advisor) | Krug, Margrit Reni | |
| Coorientador(a) (dc.contributor.advisor-co1) | Rhod, Eduardo Luis | |
| Lattes Coorientador(a) (dc.contributor.advisor-co1Lattes) | http://lattes.cnpq.br/2146647990461845 | pt_BR |
| Lattes Orientador(a) (dc.contributor.advisorLattes) | http://lattes.cnpq.br/3524433143718420 | pt_BR |
| Autor(a) (dc.contributor.author) | Lessinger, Samuel | |
| Autor(a) Lattes (dc.contributor.authorLattes) | http://lattes.cnpq.br/0704569638418865 | pt_BR |
| Data de Disponibilização (dc.date.accessioned) | 2017-10-25T13:48:52Z | |
| dc.date.available (dc.date.available) | 2017-10-25T13:48:52Z | |
| Data da defesa / Data do evento (dc.date.issued) | 2017-09-21 | |
| Abstract (dc.description.abstract) | This work consists on a proposal of a DDR3 SDRAM memory module reconfigurable test platform. Memory module testers are usually closed architecture systems, in which the user has little flexibility in their use. In this scenario, a low-cost portable platform, which enables the user to describe his own test algorithm becomes interesting. This work explores the use of Field Programmable Gate Arrays (FPGAs) in order to construct a fully reconfigurable testing platform. In this work a Stuck-At-Zero fault injection strategy was proposed and validated. Results report the success in executing fault detection algorithms as well as the software framework developed for the fault injection campaign. | en |
| Resumo (dc.description.resumo) | O presente trabalho consiste em uma proposta de uma plataforma reconfigurável para testes de módulos de memória SDRAM DDR3. Testadores de módulos de memória consistem em sistemas de arquiteturas fechadas, nos quais o usuário possui pouca flexibilidade em sua utilização, transporte e são na maioria das vezes sistemas volumosos próprios para uso em bancadas. Neste cenário, uma plataforma portátil de baixo custo, que possibilite ao usuário descrever os algoritmos de teste torna-se interessante. A plataforma desenvolvida utiliza de Field Programmable Gate Arrays (FPGA) o que proporciona a característica de reconfiguração. Neste projeto foi proposta e validada uma estratégia de injeção de falhas do tipo Stuck-At-Zero, aliado a um sistema automático para coleta de vetores de teste e para a síntese em diferentes frequências de acesso aos módulos de memória. A etapa de validação do protótipo desenvolvido possibilitou reportar a captura de 131.751 falhas, graças ao framework criado para acompanhar a tarefa de injeção de falhas. | pt_BR |
| Agência de fomento (dc.description.sponsorship) | PADIS - Programa de apoio ao desenvolvimento tecnológico da indústria de semicondutores | pt_BR |
| URI (dc.identifier.uri) | http://www.repositorio.jesuita.org.br/handle/UNISINOS/6724 | |
| Idioma (dc.language) | pt_BR | pt_BR |
| Nome da instituição (dc.publisher) | Universidade do Vale do Rio dos Sinos | pt_BR |
| País da Instituição (dc.publisher.country) | Brasil | pt_BR |
| Departamento (dc.publisher.department) | Escola Politécnica | pt_BR |
| Sigla da Instituição (dc.publisher.initials) | Unisinos | pt_BR |
| Programa (dc.publisher.program) | Programa de Pós-Graduação em Engenharia Elétrica | pt_BR |
| Direitos de acesso ao documento (dc.rights) | openAccess | pt_BR |
| Assunto (dc.subject) | Teste eletrônico | pt_BR |
| Assunto (dc.subject) | Memória SDRAM DDR3 | pt_BR |
| Assunto (dc.subject) | Hardware reconfigurável | pt_BR |
| Assunto (dc.subject) | FPGA | pt_BR |
| Assunto (dc.subject) | Teste de memória | pt_BR |
| Assunto (dc.subject) | Electronic testing | en |
| Assunto (dc.subject) | DDR3 SDRAM memory | en |
| Assunto (dc.subject) | Reconfigurable hardware | en |
| Assunto (dc.subject) | Memory test | en |
| Tema (CNPq) (dc.subject.cnpq) | ACCNPQ::Engenharias::Engenharia Elétrica | pt_BR |
| Título (dc.title) | Proposta de uma plataforma reconfigurável para testes de módulos SDRAM DDR3 | pt_BR |
| Tipo de arquivo (dc.type) | Dissertação | pt_BR |
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