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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 411 |
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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 3 | 7 | 6 | 7 | 3 | 5 | 11 |
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| Rafael de Figueredo Viana_.pdf | 240 |
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| Brasil | 411 |
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