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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 380 |
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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 12 | 16 | 0 | 5 | 3 | 7 | 1 |
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| Rafael de Figueredo Viana_.pdf | 221 |
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| Brasil | 380 |
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